【コラム】

セカンド・オピニオン

14 64bit Rhapsody IA-32とYamhill(3)

 

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○Yamhill=RISC+MMX/SSE/SSE2?

さて、新しいアーキテクチャが満たすべきスペックは前回( http://pcweb.mycom.co.jp/column/sopinion/sopinion013.html )紹介した通りだが、具体的にはどんな命令体系をもつようになるだろうか?

既存のx86命令セットをサポートする必要が無い以上、新しい命令セットを定める上での自由度は極めて高い。レジスタベースの演算や3オペランド命令のサポート、多数の汎用レジスタ、命令長固定といった、多くのRISCプロセッサが持つ特徴はいずれも兼ね備えるのは間違いなさそうだ。こうした特徴は、いずれもデコード/命令段での処理の簡略化に繋がるし、これは相対的に動作クロックの向上にも繋がる事になる。具体的な姿、というのは何しろ自由度が高すぎて想像がつかないのだが、割とコンサバティブなものになるかもしれない。

その一方、既存のSSE/SSE2といった命令はそのままか、あるいは多少フォーマットを変える程度で残る事になると思われる。MMXはちょっと微妙なところで、筆者としては、ひょっとするとなくなるかもしれないが、一応残るのではないかと予測している。というのは、こうしたSIMD演算命令系はいずれも、x86の弱点を補う形の命令構造になっており、RISC系プロセッサにも適用させやすいからだ。実際、Itanium/Itanium2にもSSEは搭載されているし、XScaleにもWireless MMXなる名前でMMX互換命令を搭載するなど、IntelはこのSIMD系命令セットを大事にしている。従って、これらの命令はそのまま継承されるのではないかと思う。

ちなみにアドレスは64bit、データは32bitを基本とする事になるだろう。勿論、浮動小数点演算は(SSE/SSE2と別に設けるか、はちょっと謎だが)64bitデータ型をサポートするだろうし、ひょっとするとDouble Double型、あるいはSuper Double型などと呼ばれる128bitデータ型をサポートするかもしれない。ただ、浮動小数点演算はデータ幅が増えると、必要とされるトランジスタ数も飛躍的に増えてゆく傾向がある。この新プロセッサが登場する時期になると、トランジスタバジェットの面ではおそらくゆとりはあると思うが、パイプラインを高速に動作させる点でちょっと心配ではある。また、こうした高精度浮動小数点演算を必要とするのは、一部の科学技術演算のみなのが現状であり、ニーズの点からも必要性にはちょっと疑問がある。

○アドレス指定でもうひとつ

さて、Yamhillに関して語るべきことは大体終わったのだが、もうひとつだけ残っている話がある。それは、アドレス指定の話だ。前回も触れた通り、筆者はYamhillに関してはフラットアドレスを利用するのではないかと想像している。では、仮想アドレスは64bitで固定、物理アドレスも32bitを超えて、例えば40bitとか42bitとかになり、後は仮想アドレス←→物理アドレスの変換だけをすればすむのかというと、どうもそれだけでは足りない雰囲気である。

何が足りないか、というと今年のIDF Fall 2002でIntelが発表したLaGrande Technology( http://pcweb.mycom.co.jp/news/2002/09/10/22.html )である。セキュリティ強化のアーキテクチャであるこのLaGrande、まだ基調講演で名前が出た程度のレベルで、実際にインプリメントされたチップが登場したとかそういう話ではないのだが、今後のIntelのプロセッサには確実に搭載されてゆくテクノロジであるから、当然無視はできない。

さてこれが無視出来ないのはともかく、なぜアドレス指定に関係するかと言うと、そのテクノロジの内部が多少明らかにされているからだ、今年10月に日本で開催されたIDF Fall 2002 JapanにIntelのPat Gelsinger氏が来日、基調講演を行い( http://pcweb.mycom.co.jp/news/2002/10/23/24.html )、プレス向けラウンドテーブルなども開催されたのであるが、これらの中で明らかにされた事に

・LaGrandeは、例えば保護が必要なアプリケーションは他のアプリケーションはおろか、OSからも見えないような仕組みを提供する事が出来る

という話が入っていたからだ。この仕組みをまともに考えてゆくと、仮想アドレス←→物理アドレス変換だけではどうしても機能が不足してしまうのである。このあたりは次回もう少し紹介したい。

バックナンバー
http://pcweb.mycom.co.jp/column/sopinion.html

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インデックス

連載目次
第421回 MCUで遊ぼう Part2 (12)
第420回 MCUで遊ぼう Part2 (11)
第419回 MCUで遊ぼう Part2 (10)
第418回 MCUで遊ぼう Part2 (9)
第417回 MCUで遊ぼう Part2 (8)
第416回 MCUで遊ぼう Part2 (7)
第415回 MCUで遊ぼう Part2 (6)
第414回 MCUで遊ぼう Part2 (5)
第413回 MCUで遊ぼう Part2 (4)
第412回 MCUで遊ぼう Part2 (3)
第411回 MCUで遊ぼう Part2 (2)
第410回 MCUで遊ぼう Part2 (1)
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第56回 バスのアーキテクチャ - 過去から未来へ(17)
第55回 バスのアーキテクチャ - 過去から未来へ(16)
第54回 バスのアーキテクチャ - 過去から未来へ(15)
第53回 バスのアーキテクチャ - 過去から未来へ(14)
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第51回 バスのアーキテクチャ - 過去から未来へ(12)
第50回 バスのアーキテクチャ - 過去から未来へ(11)
第49回 バスのアーキテクチャ - 過去から未来へ(10)
第48回 バスのアーキテクチャ - 過去から未来へ(9)
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第46回 バスのアーキテクチャ - 過去から未来へ(7)
第45回 バスのアーキテクチャ - 過去から未来へ(6)
第44回 バスのアーキテクチャ - 過去から未来へ(5)
第43回 バスのアーキテクチャ - 過去から未来へ(4)
第42回 バスのアーキテクチャ - 過去から未来へ(3)
第41回 バスのアーキテクチャ - 過去から未来へ(2)
第40回 バスのアーキテクチャ - 過去から未来へ(1)
第39回 NuCORE Image Processor - Embedded Processorの一断層(8)
第38回 NuCORE Image Processor - Embedded Processorの一断層(7)
第37回 NuCORE Image Processor - Embedded Processorの一断層(6)
第36回 NuCORE Image Processor - Embedded Processorの一断層(5)
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第32回 NuCORE Image Processor - Embedded Processorの一断層(1)
第31回 パーソナルな64bit環境はいつ手に入る?
第30回 64bit Rhapsody 新しい地平を切り開くItanium(10)
第29回 64bit Rhapsody 新しい地平を切り開くItanium(9)
第28回 64bit Rhapsody 新しい地平を切り開くItanium(8)
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第26回 64bit Rhapsody 新しい地平を切り開くItanium(6)
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第22回 64bit Rhapsody 新しい地平を切り開くItanium(2)
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第20回 64bit Rhapsody OSを持たないハードウェアの悲劇(4)
第19回 64bit Rhapsody OSを持たないハードウェアの悲劇(3)
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第17回 64bit Rhapsody OSを持たないハードウェアの悲劇
第16回 64bit Rhapsody IA-32とYamhill(5)
第15回 64bit Rhapsody IA-32とYamhill(4)
第14回 64bit Rhapsody IA-32とYamhill(3)
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第11回 64bit Rhapsody Hammerの理想と現実(7)
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第5回 64bit Rhapsody Hammerの理想と現実(1)
第4回 64bit Rhapsody それでもある64bitの需要(2)
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第2回 64bit Rhapsody 一人歩きする64bit(2)
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